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数据结构：选择排序(Python实现)
选择排序原理不在这里详细讲
#非稳定排序算法
def select_sort(shuzu):nlen(shuzu)for i in range(n-1):minifor j in range(i1,n):if shuzu[j]<shuzu[min]:minjshuzu[min],shuzu[i]shuzu[i],shuzu[min]return shuzu
import timeif __name____main__:t1 time.time()a [1,…
五、Golang 中的数组Array以及Slice底层实现
1、Array(数组) 数组是指一系列同一类型数据的集合。数组中包含的每个数据被称为数组元素 (element)，这种类型可以是任意的原始类型，比如 int 、 string 等，也可以是用户自定义的类型。一个数组包含的元素个数被称为数组的长度。 在 Golang 中数组是一个长度固定的数据类…
![Shell ${!shuzu[@]} 获取数组的所有下标](http://pic.002.xiahunao.cn/pnds/Shell ${!shuzu[@]} 获取数组的所有下标)
Shell ${!shuzu[@]} 获取数组的所有下标
在shell脚本中，数组是经常用到的。有时，数组中元数的个数是不确定的。 我们知道，获取数组的元素个数：${#array[]}；获取数组的所有元素${array[*]}。 那么有没有办法直接获取数组的所有下标呢？${!shuzu[]} …
Allegro 17.2 xnet设置不成功解决方法
Allegro 17.2 xnet设置不成功解决方法
ALLEGRO 17.2 XNET设置不成功解决方法
1 ALLEGRO 17.2 XNET设置不成功
新建PCB设置成功。导出约束文件，对比设置差异。 发现有问题的PCB，XNetsDMLOn没有设置。
2 解决方法
将正常的约束文件导出，导…
Allegro XNET,RePP,MGrP的关系
1、建立MGrP时，会发现有个XNET下有多个RePP(XNET本身就是多个网络的组合)； 解决方法
1.1 XNET建立(Repp)pin pair... 关系 1.2 选择你需要的点到点 网络关系； 1.3 将你需要的Repp 添加到MGrP,而不是将这个XNET添加到MGrP。
您明白了吗&…
 之 Allegro中的XNet设置)
Cadence Allegro PCB设计88问解析(六) 之 Allegro中的XNet设置
一个学习信号完整性仿真的layout工程师 在我们的进行layout设计时，尤其是在一些差分走线上，经常会遇到串联电阻或者电容的情况，可能在信号速率不高或者spec要求不严格时，我们会忽略独立器件另一端较短走线的长度延时，但…
探索NI-XNET：汽车网络测试与仿真的利器
探索NI-XNET：汽车网络测试与仿真的利器 【下载地址】NI-XNET样例程序 本仓库提供了NI-XNET设备的样例程序。NI-XNET为配置、开发和调试应用程序提供支持，适用于汽车以太网、CAN、LIN和FlexRay网络的原型验证、仿真和测试。NI-XNET是一个NI仪器驱动程序&a…
allegro中Xnet设置与删除（包括多引脚元器件模型Xnet设置）
allegro中Xnet设置 1、打开allegro->Analyze->Mode Assigment,如图 弹出框点击ok-> 点击是，弹出如下页面，就是要设置的Xnet 模型的页面： 2、在Refdes中输出你要创建Xnet模型的元器件即可；例如如下输入一个电阻&#x…
Allegro17.2不能创建XNET的解决办法
本文来自Cadence官方论坛的网络回复，本文改为中文和配图。
1、打开ENV，增加set CDS_XNET_STATE_UI1； 2、重新打开Allegro和规则管理其器；
3、从规则管理器 Tools > Options 选择 “Create XNets and Differential Pairs usin…
Allegro中设置Xnet等长
过电阻的等长线设置 1. 红色圈圈内的图标就是规则管理器，点击打开 我们可以看到这样：等长线规则在Relative Propagation Delay(相对传播延时) 我们发现所有的网络属性都是Net，如果我们想要过电阻等长布线，则需要将高速信号的网络建…
记录：Allegro无法删除元器件XNET属性
最近在画板时发现导入到PCB中的很多元器件自带了XNET属性，搞不清楚怎么添加的，但是确定不是自己主动添加的，网上找了很多方法均无效果，现在暂时记录一下 在allegro的分析菜单（Analyze）里面的的Mode Assignm…
01-Cadence17.4差分组内Xnet的创建与等长布线
Cadence17.4差分组内Xnet的创建与等长布线
1.原理图说明
1.如下图所示，原理图在设计时会有过电容的差分线，我以USB3.0的TX引脚为例，其线上有100nF的耦合电容，另外两组线是U3的RX引脚和U2的数据引脚。 2.以上三对线呢假设需要组内…
使用NI-XNET去测试CAN通信
大家好，我最近正在做一个测试，就是我在matlab里面用了CAN pack这个模块，将dbc文件放进去了。然后我就生成代码，导入到veristand里面了，然后这个模型我不知道怎么和veristand里XNET的CAN进行mapping， 我就是…
Allegro如何取消Xnet操作指导
在实际Layout过程中，差分对上往往串接有电阻，电容或共模电感。这时候就需要创建Xnet。那么Allegro如何创建Xnet呢？ 1、点击菜单 Analyze（分析）→Model Assigment（模型分配），如下图所…
allegro 删除默认生成的xnet
在orcad中画好原理图，同步到pcb后，查看引脚时，发现会出现一些xnet，但有的xnet我们并不需要，比如我这里的SCKN与SCKP的差分时钟信号之间并联了一个电阻，而它自动把他们俩识别成了一个xnet，导致我…
Allegro如何创建Xnet操作指导
在实际Layout过程中，差分对上往往串接有电阻，电容或共模电感。这时候就需要创建Xnet。那么Allegro如何创建Xnet呢？ 具体操作如下： 1、点击菜单 Analyze（分析）→Model Assigment（模型分配），如下图所示 2、跳出SI Design Audit对话框，直接点OK，如下图所示 3、接着跳出…
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