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VISIA 皮肤检测
费用:自费158元 不能医保报销 先清洁肌肤,然后做一个皮肤检测.
1200万像素高清摄像头,一个白光,一个偏正光,还有一个紫外光,三种模式,分析面部情况.
8张图 反应皮肤情况应用: 在医美前和医美一次修复完成后,皮肤情况对比. 数值越高 越好
斑点图: 皱纹图: 分数比较低的话,皮肤…
金手指layout建议（一）)
PCIe5.0的Add-in-Card(AIC)金手指layout建议（一）
PCIe CEM规范允许两种不同的AIC金手指设计，一种是满足32.0 GT/s的要求，另一种是用在16.0 GT/s及以下的情况。
首先说一下第一种情况，“Full Core Shielding Planes with Fingertip South Vias” 即在金手指的内层将地平面铺到金手指边缘的地…
DiffPair combined void for via高速差分过孔增加椭圆避让区
DiffPair combined void for via added with Return Path option
偶然发现allegro这个选项挺好用的，移动过孔避让区也会同步，避免了手工加的禁布区不随过孔移动的问题。
但是这个选项对负片层不起作用，对用惯了负片层的多层板没法用了。
大…
Altium Designer22设计规则检查违反约束详细说明
电气规则检查如下 1、Clearance Constraint (Gap=10mil) (All),(All) 间隙约束 也就是约束PCB中的电气间距，比如线与线之间的间距，阻容各类元件的焊盘间距小于规则中的设定值，即报警，报警如下 规则设置方式如下： 该规则可以设置不同类型电气组件的间距约束值，如上图的表…
Enhanced training of query-based object detection via selective query recollection
Abstract
本文研究了基于查询的目标检测器在最后解码阶段预测错误，而在中间阶段预测正确的现象。我们回顾了训练过程，并将这种被忽视的现象归因于两个限制:缺乏训练重点和解码序列的级联错误。我们设计并提出了一种简单有效的基于查询的目标检测器训练策…
Allegro教学：关于dangling connection的解释
在PCB布线之后需要通过allegro提供的Reports功能检查问题，并提供报告，其中一项重要的检查是名为dangling lines, vias and antenna的检查，他可以帮你检查出当前绘制中有没有悬空多余的线和过孔。 新人可能会对dangling lines, vias和 ante…
![[原创]Cadence软件使用记录8_Allegro绘制PCB菜鸟初成](http://pic.002.xiahunao.cn/pnds/[原创]Cadence软件使用记录8_Allegro绘制PCB菜鸟初成)
[原创]Cadence软件使用记录8_Allegro绘制PCB菜鸟初成
先对前述文章做个补充： 有的接插件是有机械孔的，这个mechanical hole有讲究，字不重要看图： 需要指明每一层的连接几何尺寸，17.2最高支持32层VIA，所以要问，我就画四层板，中间不应该是…
约束规则设置、电路板布线、电源和地平面处理
约束规则设置 电路板布线 电源和地平面处理 约束规则设置
1.net class内对象编辑 2.net class添加physical约束方法 3.net class添加spacing约束 4.net class-class间距规则 5.差分对约束及应用 6.区域约束规则 7.相对等长约束及应用 8.相关的知识XNET等 9.新建间距约束spacin…
Allegro软件操作——绘制完成后检查内容，Gerberout
一、绘制完成后检查。
1. 检查状态是否有未完成的net，DRC等，颜色变为绿色即可。 2. 通过report检查Dangling-lines,Dangling-Vias. 将报告中的Dangling-lines,Dangling-Vias根据坐标定位删除，Antenna Vias不用处理。
3. 通过report检查单端…
Altium Designer 20相关操作及使用技巧
1、复制：选中后，按shift实现复制
2、位号designator:R? C? U?
3、多个引脚，阵列式操作。引脚序号可以修改主增量和次增量实现奇偶和差值
4、镜像：在粘贴状态下按Y
5、使用现有的原理图库：在已经有的原理图中&am…
Allegro 17.4笔记（3）——PCB布线部分
Allegro 17.4笔记（1）——PCB封装库部分 Allegro 17.4笔记（2）——PCB布局部分 Allegro 17.4笔记（3）——PCB布线部分 Allegro 17.4笔记（4）——PCB输出文件部分 Part 3 PCB布线部分 1、…
ICC2:平行打孔create_pg_stapling_vias
power rail(follow pin)不总是metal1一成不变的，当需要使用metal2做power rail，而standard cell的pg pin仍然是metal1时就需要平行打孔，从metal2到metal1。
以往都是用create_pg_vias -allow_parallel_objects来做，但这样有两个弊端，一是需要抓出所有的via12(包括standar…
Allegro如何把Symbols，shapes，vias，Clines，Cline segs等多种元素一起移动
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在用Allegro进行PCB设计时，有时候需要同时移动某个区域的所有元素，如：Symbols，shapes，vias，Clines，Cline segs等元素。那么如何操作呢？
首先就是把Symbols，shapes，vias，Clines，Cline …
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电路板上为何要有孔洞？何谓PTH/NPTH/vias(导通孔)
http://www.greattong.com/archives/view-443-1.html 电路板上为何要有孔洞？何谓PTH/NPTH/vias(导通孔) 发布时间 :2016-07-13 09:39 阅读 :3613 来源 :技术文章 责任编辑 :深圳宏力捷PCB制板部 如果你有机会拿起一片 电路板，稍微观察一下会发现这电路…
PCB基础~PCB介质，Vias
PCB介质
• 一般的介质材料 – FR-4（玻璃纤维和环氧基树脂交织而成） • 最常和最广泛使用，相对成本较低 • 介电常数：最大4.7， 4.35500Mhz,4.341Ghz • 可承受的最高信号频率是2Ghz(超过这个值，损耗和串扰…
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Leetcode 3：Longest Substring Without Repeating Characters(最长不重复子串)
Description Given a string, find the length of the longest substring without repeating characters. 给你一个字符串，求出其最长不重复字串的长度。 Example
Input: "abcabcbb"
Output: 3
Explanation: The answer is "abc", with the l…
ASP.NET Web Api使用CacheCow和ETag缓存资源
ASP.NET Web Api使用CacheCow和ETag缓存资源 ASP.NET Web Api使用CacheCow和ETag缓存资源 ASP.NET Web Api使用CacheCow和ETag缓存资源 2015-07-15 FZRAIN dotNET跨平台 前言 本文将使用一个开源框架CacheCow来实现针对Http请求资源缓存，本文主要介绍服务器端的缓存…
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